IMSET01 特价销售

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 FIFO缓存设计

由于A/D转换器、FPGA以及显示器之间处理数据的速度不同，为了消除不必要的数据丢失或者重复读取和数据丢失，可以将处理后的数据暂时存入FIFO中。FIFO是一个先入先出的堆栈，利用FPGA内部强大的寄存器功能，设计了一个FIFO的数据缓冲器。

A/D转换器将转换好的数据存入FIFO缓存中，FPGA检测液晶显示器有无读信号，如果有读信号，则FIFO输出信号给显示器；如果没有，则数据继续存储在FIFO中，等待被取走。这样便不会有数据丢失，系统更安全完整。